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西門子與臺積電深化合作,不斷攀登設計工具認證高峰

來源: 中電網
2021-11-05
類別:業界動態
eye 38
文章創建人 拍明

原標題:西門子與臺積電深化合作,不斷攀登設計工具認證高峰

西門子與臺積電深化合作,不斷攀登設計工具認證高峰,這一合作體現在多個方面,包括EDA(電子設計自動化)產品的工藝認證、先進封裝技術的支持以及測試解決方案的開發等。以下是對這一合作的具體分析:

一、EDA產品工藝認證

西門子與臺積電在EDA產品工藝認證方面取得了顯著成果。西門子EDA產品線中的多個關鍵產品已經成功通過臺積電最新工藝技術的認證,包括:

  • Calibre nmPlatform:這是一款用于IC sign-off(集成電路簽核)的領先物理驗證解決方案,已經獲得了臺積電N2、N3E、N3P和N4P等先進工藝的認證。Calibre nmPlatform包括Calibre nmDRC、Calibre YieldEnhancer、Calibre PERC和Calibre nmLVS等多個軟件,這些軟件共同構成了強大的物理驗證平臺,有助于客戶在最新的工藝節點上實現高質量的芯片設計。

  • Analog FastSPICE平臺:該平臺專為納米級模擬、射頻(RF)、混合信號、存儲器和定制數字電路提供快速電路驗證。它已成功獲得臺積電N5A、N3E、N3P和N2等工藝的認證,為客戶提供了強大的電路驗證能力。

  • mPower模擬軟件:該軟件適用于使用臺積電N4P工藝的晶體管級電遷移和IR下降(EM/IR)驗證,進一步擴展了西門子在模擬驗證領域的優勢。

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二、先進封裝技術支持

西門子與臺積電在先進封裝技術方面也展開了深入合作。西門子成功滿足了臺積電尖端3DFabric設計流程的設計要求,包括對其Xpedition Package Designer(xPD)工具的改進,以支持使用自動避免和校正功能進行扇出型晶圓級封裝(InFO)設計規則處理。此外,Calibre 3DSTACK、DRC和LVS等EDA工具也獲得了臺積電最新的3DFabric技術(包括InFO、CoWoS和TSMC-SoIC)的支持與認證,有助于縮短客戶的設計和簽核周期,并減少與人工干預相關的錯誤。

三、測試解決方案開發

為了支持臺積電的3D硅堆疊架構,西門子還開發了可測試性設計(DFT)流程。西門子的Tessent軟件提供了基于層次化DFT、SSN(Streaming Scan Network)、增強型TAP(測試接入端口)和IEEE 1687 IJTAG(內部聯合測試行動小組)網絡技術的領先DFT解決方案。這些解決方案符合IEEE 1838標準,具備可擴展、靈活性和易用性等特點,有助于客戶優化與IC測試技術相關的資源。

四、合作成果與展望

西門子與臺積電的合作不僅體現在上述具體的產品和技術認證上,還體現在雙方共同推動芯片創新、加速客戶產品上市速度等方面。西門子IC-EDA執行副總裁Joe Sawicki表示:“臺積電的創新速度令人矚目,我們很榮幸能與這個合作伙伴合作,為我們的眾多共同客戶謀福利。”未來,隨著半導體技術的不斷發展,西門子與臺積電的合作還將繼續深化,共同推動芯片設計行業的進步和發展。

綜上所述,西門子與臺積電在EDA產品工藝認證、先進封裝技術支持和測試解決方案開發等方面展開了深入合作,并取得了顯著成果。這些合作不僅提升了雙方的技術實力和市場競爭力,也為全球芯片設計行業的創新和發展做出了重要貢獻。

責任編輯:David

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